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specification-to-temporal-logic-generator

Translate natural-language requirements or structured specification documents into formal temporal logic properties (LTL, CTL, safety/liveness properties). Use when users need to formalize requirements for model checking, formal verification, or property specification. Handles embedded/real-time systems, hardware verification, concurrent systems, and reactive systems. Resolves ambiguities, asks clarifying questions when needed, and outputs machine-checkable formulas with explanations. Supports multiple output formats (SPIN, NuSMV, Uppaal, TLA+, Maude).

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Informations de source

Dépôt
ArabelaTso/Skills-4-SE
Dernière activité de la source
20 février 2026 à 09:49
Langue détectée de SKILL.md
anglais
Étoiles
240
Forks
22

Options d'installation

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