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specification-to-temporal-logic-generator

Translate natural-language requirements or structured specification documents into formal temporal logic properties (LTL, CTL, safety/liveness properties). Use when users need to formalize requirements for model checking, formal verification, or property specification. Handles embedded/real-time systems, hardware verification, concurrent systems, and reactive systems. Resolves ambiguities, asks clarifying questions when needed, and outputs machine-checkable formulas with explanations. Supports multiple output formats (SPIN, NuSMV, Uppaal, TLA+, Maude).

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Informações da origem

Repositório
ArabelaTso/Skills-4-SE
Última atividade na origem
20 de fevereiro de 2026 às 09:49
Idioma detectado do SKILL.md
inglês
Estrelas
240
Forks
22

Opções de instalação

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Revise os arquivos de origem

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