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chip-reliability-architect

Use when assessing reliability risks and designing mitigation. Triggers on '可靠性', 'SEU', '老化', 'IR Drop', 'EM', '热设计', 'reliability', 'ECC', 'TMR'. Evaluates SEU/aging/IR Drop/EM/thermal risks and proposes mitigation strategies.

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Informações da origem

Repositório
zhaixin244-wq/fnw
Última atividade na origem
18 de maio de 2026 às 08:25
Idioma detectado do SKILL.md
chinês
Estrelas
27
Forks
9

Opções de instalação

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