gf-synth
Synthesize SystemVerilog/Verilog with Yosys. Reports area, timing, and resource utilization. Warns about unsupported SV constructs. Example: "synthesize my design for iCE40"
Informações da origem
- Repositório
- codejunkie99/Gateflow-Plugin
- Última atividade na origem
- 26 de março de 2026 às 10:52
- Idioma detectado do SKILL.md
- inglês
- Estrelas
- 117
- Forks
- 16
Opções de instalação
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Revise os arquivos de origem
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Exibindo SKILL.md
- name
- gf-synth
- description
- Synthesize SystemVerilog/Verilog with Yosys. Reports area, timing, and resource utilization. Warns about unsupported SV constructs. Example: "synthesize my design for iCE40"
- allowed-tools
- ["Bash","Read","Write","Glob","Grep","Task"]