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chip-low-power-architect

Use when designing low-power architecture for chip modules. Triggers on '低功耗', 'UPF', '功耗域', 'power domain', 'isolation', 'retention', 'clock gating', 'power gating'. Designs power domain partitioning, isolation/retention strategy and UPF.

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Informations de source

Dépôt
zhaixin244-wq/fnw
Dernière activité de la source
18 mai 2026 à 08:25
Langue détectée de SKILL.md
chinois
Étoiles
27
Forks
9

Options d'installation

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